分类：FPGA开发

FPGA开发：亚稳态概述

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FPGA 开发异步复位同步释放

初学者可能无需关注同步复位还是异步复位，但当深入项目细节时，复位方式是一个不得不考虑的问题，特别是一个模块中存在多个时钟时，复位的方式决定了系统的稳定性甚至功能性。关于同步复位和异步复位的介绍有空再补充。一个简单的异步复位同步释放的例子如下： module async_reset_sync_re

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FPGA开发 Block RAM（BRAM）结构及特点

BRAM，Block RAM，也称为块RAM，在某些国产FPGA中也被称为DRM。相对于分布式RAM（DRAM）而言，块RAM通常按固定大小分布在芯片中，例如 Xilinx FPGA 中的块RAM通常为 18Kb 或 36Kb，适用于需要处理大批量数据的应用场景。DRAM是利用FPGA中的查找表（L

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FPGA开发分布式RAM结构及特点

FPGA 中有专门的Block RAM用于大容量存储，也可以将LUT配置成分布式RAM，即Distributed RAM（DRAM）。

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FPGA开发异步FIFO 中格雷码的应用

异步FIFO其实没有想象中的那么简单，在实际业务中，FIFO可以说是最容易出现挂死的问题了。大家可能看着代码觉得逻辑清晰，怎么可能会出错，但是其实在很多设计中，稍微有加扰整个系统就挂死了，亚稳态只是一个最基础问题。可以再思考一下，如果FIFO的读写控制都由外部决定，是否会出现同时空满的情况？同时空满

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FPGA开发：亚稳态概述

FPGA 开发 异步复位同步释放

FPGA开发 Block RAM（BRAM）结构及特点

FPGA开发 分布式RAM结构及特点

FPGA开发 异步FIFO 中格雷码的应用

FPGA 开发异步复位同步释放

FPGA开发分布式RAM结构及特点

FPGA开发异步FIFO 中格雷码的应用