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肆拾伍
几时归去,做个闲人
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FIFO/RAM
FPGA开发 异步FIFO 中格雷码的应用
异步FIFO其实没有想象中的那么简单,在实际业务中,FIFO可以说是最容易出现挂死的问题了。大家可能看着代码觉得逻辑清晰,怎么可能会出错,但是其实在很多设计中,稍微有加扰整个系统就挂死了,亚稳态只是一个最基础问题。可以再思考一下,如果FIFO的读写控制都由外部决定,是否会出现同时空满的情况?同时空满
2024-10-18 00:02
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FPGA开发
弹