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肆拾伍
几时归去,做个闲人
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HDL
MATLAB HDL Coder 开发入门
前言:本文属于历史项目,跨越的时间线非常长,从 2021 到 2024 年,主要涉及的版本有 MATLAB 2022a 和 MATLAB 2024a。有部分函数和代码都是继承的 2022a,现在我整理时用的 2024a,会发现 HDL Coder 工具箱在这两年变化挺大,新增了很多功能,手册也修改了
2025-07-02 00:51
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HDL Coder
FPGA开发
MATALB
MATLAB 安装 MinGW-w64
错误使用 mex 未检测到支持的编译器。您可以安装免费提供的 MinGW-w64 C/C++ 编译器;请参阅安装 MinGW-w64 编译 器。有关更多选项,请访问 https://www.mathworks.com/support/compilers。 在使用 HDL Coder 工具箱时,遇到了
2025-07-01 00:40
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HDL Coder
踩坑集
MATALB
Verilog 实现不同类型的RAM
本文为个人的学习笔记,内容均为网络资料总结,价值有限~ 参考资料附在文后 RAM分类 RAM 按照功能可以分为 单端口RAM(SP),简单双端口RAM(SDP),真双端口RAM(TDP)。 按照底层实现可以分为 分布式RAM(DRAM),块RAM(BRAM),寄存器RAM(REG),有些器件也可以用
2025-04-04 23:43
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32.4℃
FPGA开发
《UVM实战》运行第一个验证平台 STEP7
本篇为验证平台的最后一个环节,step by step 的最后一步,给平台添加测试用例。 项目地址:https://github.com/shirainbown/UVM-Step-by-Step/tree/master 我们理论上已经将平台完整搭建出来了,不过还存在一个问题,虽然平台能够发送激励并且
2025-01-07 00:21
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FPGA验证
《UVM实战》运行第一个验证平台 STEP6
本文为验证平台添加了 sequence和sequencer两个组件,整个验证平台基本成型,文中并没有选择《UVM实战》2.4.3中的default_sequence 的方式,因为我在工作中也没有采用这种方式。 https://github.com/shirainbown/UVM-Step-by-St
2025-01-06 00:34
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FPGA验证
《UVM实战》运行第一个验证平台 STEP5
本篇文章在已有的基础上,继续给验证平台添加reference model 和scoreboard组件。 https://github.com/shirainbown/UVM-Step-by-Step/tree/master 1. reference model reference model 用于接
2025-01-05 00:38
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FPGA验证
《UVM实战》运行第一个验证平台 STEP4
上篇文章讲了如何添加interface,用于充当DUT 和验证平台之间的数据接口,可以避免使用绝对路径来对数据进行驱动。这篇文章尝试搭建一个较为完整的UVM平台,实现数据的驱动和采集,添加transaction,monitor,agent,env等组件。 https://github.com/shi
2025-01-04 19:49
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FPGA验证
《UVM实战》运行第一个验证平台 STEP3
driver 会生成DUT 所需要的激励信号,通过top_tb传递给DUT 的输入接口,在之前的代码里面都是直接在driver里面给top_tb的信号赋值,然后连接到DUT 的输入输出端口,本节给出规范的连接方法。 https://github.com/shirainbown/UVM-Step-by
2024-12-30 13:21
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FPGA验证
《UVM实战》运行第一个验证平台 STEP2
上文试图运行了第一个UVM平台,但实际上和真正的验证平台相差甚远,本文试图补充一些组件内容,同时解读一下书中的代码。 https://github.com/shirainbown/UVM-Step-by-Step/tree/master 我们从第一个实例可以发现,一个最基础的UVM 平台至少是需要有
2024-12-30 01:31
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FPGA验证
《UVM实战》运行第一个验证平台 STEP1
本文作为一个入门的指导吧,当时自己刚刚接触UVM 的时候一头雾水,虽然能够看明白代码但是始终没有自己运行起来。 https://github.com/shirainbown/UVM-Step-by-Step/tree/master 接上文的UVM 环境配置,按照这个配置好之后可以按照本文运行第一个U
2024-12-25 00:24
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FPGA验证
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